Low Power Design with High-Level Power Estimation and Power-Aware Synthesis (eBook)
XXII, 170 Seiten
Springer New York (Verlag)
978-1-4614-0872-7 (ISBN)
This book presents novel research techniques, algorithms, methodologies and experimental results for high level power estimation and power aware high-level synthesis. Readers will learn to apply such techniques to enable design flows resulting in shorter time to market and successful low power ASIC/FPGA design.
Introduction.- Related Work.- Background.- Architectural Selection using High Level Synthesis.- Statistical Regression Based Power Models.- Coprocessor Design Space Exploration Using High Level Synthesis.- Regression-based Dynamic Power Estimation for FPGAs.- High Level Simulation Directed RTL Power Estimation.- Applying Verification Collaterals for Accurate Power Estimation.- Power Reduction using High-Level Clock-gating.- Model-Checking to exploit Sequential Clock-gating.- System Level Simulation Guided Approach for Clock-gating.- Conclusions.
Erscheint lt. Verlag | 22.10.2011 |
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Zusatzinfo | XXII, 170 p. |
Verlagsort | New York |
Sprache | englisch |
Themenwelt | Informatik ► Weitere Themen ► CAD-Programme |
Technik ► Elektrotechnik / Energietechnik | |
Schlagworte | Hardware Software Co-Design • High Level Synthesis • Low Power Design • Power Aware Synthesis • system level design |
ISBN-10 | 1-4614-0872-5 / 1461408725 |
ISBN-13 | 978-1-4614-0872-7 / 9781461408727 |
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Größe: 4,2 MB
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